CS1180 chipsea, CS1180 Datasheet - Page 12

• Manufacturer Part Number: CS1180
• Description: CS1180
• Manufacturer: chipsea

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参数
t
t
t
t
t
t
t
t
t
t
t
t
t
t
s
spw
cs1
ds
dh
dio
dso
dsoh
dsot
cs2
sdelay
6
7
8
版
版
权
权
所
所
描述
SCLK 时钟周期
SCLK 脉冲宽度，高电平及低电平
片选信号 CS 下降沿与第一个 SCLK 沿的建立时间
SDI 数据的建立时间（与 SCLK 的延迟）
有效 SDI 数据的保持时间
在发出下列指令时 SDI 的最后一个 SCLK 时钟沿与 SDO
的第一个 SCLK 时钟沿：
RDATA, RREG, WREG
SDO 输出数据与 SCLK 的延迟时间
SDO 数据的保持时间
SDO 变为三态与 SCLK 时钟沿的延迟
片选信号 CS 保持低电平时间与最后一个 SCLK 时钟沿
当前指令的最后一
个 SCLK 时钟沿到
下一个指令的第一
个 SCLK 时钟沿：
允许的模拟输入信号的变化到下一次有效的转换
DOR 更新，DOR 无效
DRDY 信号变低后的首个 SCLK 时钟
有
有
，
，
侵
侵
权
权
必
必
究
究
RREG, WREG, SYNC, RDATA,
STOPC
OCALSYS, GCALSYS
RESET（也可以是通过 SCLK 或者
RST 引脚发出的 RESET 指令）
深
深
圳
圳
C
C
表7 CS1180 时序表
市
市
S
S
1
芯
芯
1
1
1
8
海
8
海
0
0
科
科
用
用
技
技
户
户
有
有
手
手
限
限
册
册
公
公
司
司
最小值
4
200
0
50
50
50
0
6
0
4
8
16
4
0
最大值
50
10
5000
保
保
密
密
1
1
单位
tosc 周期
ns
ns
ns
ns
tosc 周期
ns
tosc 周期
ns
tosc 周期
DRDY 周期
tosc 周期
tosc 周期
tosc 周期
tosc 周期
2
2
文
文
-
-
档
档
2
2
5
5