XC3S400AN-5FTG256C Xilinx Inc, XC3S400AN-5FTG256C Datasheet - Page 3
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XC3S400AN-5FTG256C
Manufacturer Part Number
XC3S400AN-5FTG256C
Description
IC FPGA SPARTAN-3AN 256FTBGA
Manufacturer
Xilinx Inc
Series
Spartan™-3ANr
Specifications of XC3S400AN-5FTG256C
Number Of Logic Elements/cells
8064
Number Of Labs/clbs
896
Total Ram Bits
368640
Number Of I /o
195
Number Of Gates
400000
Voltage - Supply
1.14 V ~ 1.26 V
Mounting Type
Surface Mount
Operating Temperature
0°C ~ 85°C
Package / Case
256-LBGA
Lead Free Status / RoHS Status
Lead free / RoHS Compliant
Available stocks
Company
Part Number
Manufacturer
Quantity
Price
Company:
Part Number:
XC3S400AN-5FTG256C
Manufacturer:
Xilinx Inc
Quantity:
10 000
Table of Contents
Spartan-3AN In-System Flash User Guide
UG333 (v2.1) January 15, 2009
Chapter 1: Overview and SPI_ACCESS Interface
Chapter 2: In-System Flash Memory Architecture
Chapter 3: Read Commands
Chapter 4: Write and Program Commands
In-System Flash Summary
Accessing In-System Flash Memory After Configuration
Related Materials and References
Block Diagram
Flash Memory Array
Addressing Overview
Delivered State
Memory Allocation Tables
MultiBoot Configuration Bitstream Guidelines
User Data Storage Guidelines
Fast Read
Random Read
Page to Buffer Transfer
Buffer Read
Buffer Write
Buffer to Page Program with Built-in Erase
Buffer to Page Program without Built-in Erase
Page Program Through Buffer
Page to Buffer Compare (Program Verify)
Pre-initializing SRAM Page Buffer Contents
EEPROM-Like, Byte-Level Write Operations
Sequential vs. Random Page Programming, Cumulative Operations
SPI_ACCESS Design Primitive . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
HDL Instantiation Examples . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
SPI Transactions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Example Detailed Command Sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Simulation Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
Addressing Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Default Addressing Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
VHDL
Verilog
Align to Flash Sector Boundaries
Additional Memory Space Required for DCM_WAIT
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www.xilinx.com
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