AMD-K6-2E/400AFR AMD [Advanced Micro Devices], AMD-K6-2E/400AFR Datasheet - Page 330

• Manufacturer Part Number: AMD-K6-2E/400AFR
• Manufacturer: AMD [Advanced Micro Devices]

AMD-K6™-2E Processor Data Sheet
Prefetching . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Processor
PSOR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
PWT . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117
R
Read and Write
Reads, Burst Reads and Pipelined Burst . . . . . . . . . . . . . . 142
Register X and Y
Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Regulator, Voltage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 295
Reserved . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119
312
hardware . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 197
PREFETCH instruction . . . . . . . . . . . . . . . . . . . . . . . 16
software . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 197
heat dissipation path . . . . . . . . . . . . . . . . . . . . . . . . . . . . 288
state observability register (PSOR) . . . . . . . . . 40
basic I/O . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146
misaligned I/O . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 147
functional units . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
pipelines . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
3DNow!™ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
boundary-scan (BSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 231
bypass (BR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 235
control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
control 0 (CR0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
control 1 (CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
control 2 (CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
control 3 (CR3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
control 4 (CR4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
data types, floating-point . . . . . . . . . . . . . . . . . . . . . . . . . . 30
debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
descriptors and gates . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52
device identification (DIR) . . . . . . . . . . . . . . . . . . . . . . . 234
DR3–DR0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 243
DR5–DR4 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 243
DR6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 244
DR7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 244
EAX . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
EFLAGS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
extended feature enable (EFER) . . . . . . . . . . . . . . . . . . . 43
floating-point. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
general-purpose. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
IR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 231
machine-check address (MCAR) . . . . . . . . . . . . . . . . . . . . 41
machine-check type (MCTR) . . . . . . . . . . . . . . . . . . . . . . . 41
memory management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
memory type range (MTRR) . . . . . . . . . . . . . . . . . . . . . . . 45
MMX technology . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
model-specific (MSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
packed decimal data. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
PFIR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
precision real data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
PSOR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
reset state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 181
segment . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
SYSCALL/SYSRET target address (STAR) . . . . . . . . . . . 44
System Management Mode (SMM) initial state . . . . . . 219
test (TR12). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
test access port (TAP). . . . . . . . . . . . . . . . . . . . . . . . . . . . 231
TR12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
UC/WC cacheability control (UWCCR) . . . . . . . . . . . . . . 45
write handling control (WHCR) . . . . . . . . . . . . . . . . . . . . 44
X and Y . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Preliminary Information
,
23
,
,
,
45
45
44
,
,
,
,
,
,
,
,
–
197
182
182
188
216
241
31
31
19
RESET. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118
Reset and Configuration Timing . . . . . . . . . . . . . . . . . . . . 283
Return Address Stack . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
RISC86® Microarchitecture . . . . . . . . . . . . . . . . . . . . . . . . . . 8
RSM Instruction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 222
RSVD. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119
S
SAMPLE/PRELOAD Instruction . . . . . . . . . . . . . . . . . . . . 236
Sampled . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85
Scheduler/Instruction Control Unit . . . . . . . . . . . . . . . . 10
SCYC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 120
Sector, Write to a . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193
Segment
Shift-DR state. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 238
Shift-IR state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 238
Shutdown Cycle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 172
Signals
and configuration signals for 100-MHz bus operation . 278
and configuration signals for 66-MHz bus operation . . 279
and test signal timing . . . . . . . . . . . . . . . . . . . . . . . . . . . 278
requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 180
signals sampled during . . . . . . . . . . . . . . . . . . . . . . . . . . 179
state of processor after . . . . . . . . . . . . . . . . . . . . . . . . . . 180
descriptor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
task state. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48
usage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
A[31:3]. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87
A20M# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86
ADS# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88
ADSC#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88
AHOLD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89
AP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90
APCHK# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91
BE[7:0]# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92
BF[2:0]. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93
BOFF# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94
BRDY#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95
BRDYC# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96
BREQ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96
CACHE# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97
cache-related . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 190
CLK . . . . . . . . . . . . . . . . . . . . . . 97
D/C#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98
D[63:0]. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 99
descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85
DP[7:0] . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 100
EADS#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101
EWBE# . . . . . . . . . . . . . . . . . . . . . . . . . . . 102
FERR#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103
FLUSH# . . . . . . . . . 104
HIT# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
HITM# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
HLDA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106
HOLD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107
IGNNE#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
INIT . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
INTR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110
INV . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110
KEN# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 111
LOCK#. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
,
132
,
179
,
,
247
200
22529B/0—January 2000
,
,
250
226
,
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,
,
224
252
205
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218
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162
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249
249
249
,
Index
52
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–
–
–
–
–
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–
180
225
197
218
249
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268
251
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251
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216
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250
17
54