SC28L202A1DGG,118 NXP Semiconductors, SC28L202A1DGG,118 Datasheet - Page 2

• Manufacturer Part Number: SC28L202A1DGG,118
• Description: IC UART DUAL W/FIFO 56-TSSOP
• Manufacturer: NXP Semiconductors
• Series: IMPACTr

Specifications of SC28L202A1DGG,118

• Features: False-start Bit Detection
• Number Of Channels: 2, DUART
• Fifo's: 256 Byte
• Voltage - Supply: 3.3V, 5V
• With Parallel Port: Yes
• With Auto Flow Control: Yes
• With False Start Bit Detection: Yes
• With Modem Control: Yes
• With Cmos: Yes
• Mounting Type: Surface Mount
• Package / Case: 56-TFSOP (0.240", 6.10mm Width)
• Lead Free Status / RoHS Status: Lead free / RoHS Compliant
• Other names: 935276109118; SC28L202A1DGG-T; SC28L202A1DGG-T

Philips Semiconductors
DESCRIPTION
FEATURES
ORDERING INFORMATION
PIN CONFIGURATIONS
PIN CONFIGURATION FOR 80XXX BUS INTERFACE (INTEL)
CONFIGURATION FOR 68XXX BUS INTERFACE (MOTOROLA)
OVERALL DESCRIPTION
PROGRAMMING THE HOST INTERFACE
REGISTER DESCRIPTION AND PROGRAMMING NOTE
2005 Nov 01
Dual universal asynchronous receiver/transmitter
(DUART)
BRIEF DESCRIPTION OF FUNCTIONAL BLOCKS
DETAILED DESCRIPTIONS
UART Operation
Registers that control Global Properties of the 28L202
UART Registers
Bus Interface
Timing Circuits
I/O ports
UARTs
Transmitters and Receivers
Character and Address Recognition
Flow Control
Test Modes and Software
Bus Interface
Timing Circuit
I/O Ports
Receiver Operation
Arbitrating Interrupt Structure
GCCR – Global Configuration Control Register
GCCR(7:6) DACKN Assertion
GCCR(5:3): Reserved
GCCR(2:1): Interrupt vector configuration
GCCR(0): Interrupt Status Masking
SFSR A and B Special Feature & Status Register
SFSR(7:4) Reserved
SFSR(3) Status of loop back error check.
SFSR(0) Reserved
TRR Test and Revision Register.
TRR[7] Test 2 Enable
TRR[6:0] – Chip Revision Code
STCR – Scan Test Control Register.
SES – System Enable Status Register, A and B
EOS – Enhanced Operation Status Register
These registers are generally concerned with formatting, transmitting and receiving data.
MR0 – Mode Register 0, A and B
MR0[7] Fixed length Watchdog Timer
MR0[5:4] – Tx interrupt fill level.
MR0[3] – FIFO Size
MR0[2:0] – Legacy Baud Rate Group Selection
MR1 – Mode Register 1, A and B
MR1[7] – Receiver Request to Send (hardware flow control)
MR1[6] – Receiver interrupt control bit 1.
MR1 [5] – Error Mode Select and sub modes
MR1[4:3] – Parity Mode Select
MR1[2] – Parity Type Select
MR1[1:0] – Bits per Character Select
MR2 – Mode Register 2, A and B
MR2[7:6] – Mode Select
MR2[7:6] = b’00 Normal Mode
MR2[7:6] = b’01 Automatic Echo
MR2[7:6] = b’10 selects local loop back diagnostic mode. In this mode:
MR2 [7:6] = b’11 Selects the Remote Loop back diagnostic mode. In this mode:
MR2[5] Transmitter Request to Send Control
MR2[4] – Clear to Send Control
MR2[3:0] – Stop Bit Length Select
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SC28L202
Product data sheet
12
17
18
18
18
18
18
18
18
19
19
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1
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2
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4
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9