GS72108J-10 ETC, GS72108J-10 Datasheet - Page 2

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GS72108J-10

Manufacturer Part Number
GS72108J-10
Description
256K x 8 2Mb Asynchronous SRAM
Manufacturer
ETC
Datasheet
TSOP-II 256K x 8-Pin Configuration
Rev: 1.08 7/2002
Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.
Block Diagram
A
NC
NC
A
A
A
A
A
CE
DQ
DQ
V
V
DQ
DQ
WE
A
A
NC
NC
A
A
15
4
3
2
1
0
DD
SS
14
13
16
17
1
2
3
4
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
400 mil TSOP II
44-pin
WE
OE
CE
A
A
17
0
Address
Control
Buffer
Input
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
NC
NC
NC
A
A
A
A
OE
DQ
DQ
V
V
DQ
DQ
A
A
A
NC
NC
NC
NC
Decoder
2/12
A
5
6
7
8
SS
DD
10
11
12
9
Row
8
7
6
5
Memory Array
DQ
I/O Buffer
Column
Decoder
1
DQ
8
© 1999, Giga Semiconductor, Inc.
GS72108TP/J

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