MC68HC908LD60IFU Freescale Semiconductor, MC68HC908LD60IFU Datasheet - Page 15

• Manufacturer Part Number: MC68HC908LD60IFU
• Manufacturer: Freescale Semiconductor

Specifications of MC68HC908LD60IFU

• Cpu Family: HC08
• Device Core Size: 8b
• Frequency (max): 6MHz
• Program Memory Type: Flash
• Program Memory Size: 60KB
• Total Internal Ram Size: 1KB
• # I/os (max): 39
• Number Of Timers - General Purpose: 2
• Operating Supply Voltage (typ): 3.3V
• Operating Supply Voltage (max): 3.6V
• Operating Supply Voltage (min): 3V
• On-chip Adc: 6-chx8-bit
• Instruction Set Architecture: CISC
• Operating Temp Range: 0C to 85C
• Operating Temperature Classification: Commercial
• Mounting: Surface Mount
• Pin Count: 64
• Package Type: PQFP
• Lead Free Status / Rohs Status: Compliant

MC68HC908LD60
Freescale Semiconductor
—
Rev. 1.1
16.5.1.1
16.5.1.2
16.5.1.3
16.5.2
16.5.3
16.5.4
16.5.5
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17.6
17.6.1
17.6.2
System Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .229
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .231
Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 232
Sync Processor I/O Registers. . . . . . . . . . . . . . . . . . . . . . . . . 219
Port A . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 235
Port B . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 238
Port C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 241
Port D . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 244
Sync Signal Counters. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 217
Polarity Controlled HOUT and VOUT Outputs . . . . . . . . . . 217
Clamp Pulse Output . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 218
Low Vertical Frequency Detect . . . . . . . . . . . . . . . . . . . . . 219
Sync Processor Control & Status Register (SPCSR). . . . . 219
Sync Processor Input/Output Control Register (SPIOCR) . 221
Vertical Frequency Registers (VFRs). . . . . . . . . . . . . . . . . 223
Hsync Frequency Registers (HFRs). . . . . . . . . . . . . . . . . . 225
Sync Processor Control Register 1 (SPCR1). . . . . . . . . . . 227
H & V Sync Output Control Register (HVOCR) . . . . . . . . . 228
Port A Data Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 235
Data Direction Register A . . . . . . . . . . . . . . . . . . . . . . . . . 236
Port A Options . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 237
Port B Data Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 238
Data Direction Register B . . . . . . . . . . . . . . . . . . . . . . . . . 239
Port B Options . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 240
Port C Data Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 241
Data Direction Register C . . . . . . . . . . . . . . . . . . . . . . . . . 242
Port C Options . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 243
Port D Data Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 244
Data Direction Register D. . . . . . . . . . . . . . . . . . . . . . . . . . 245
Hsync Polarity Detection . . . . . . . . . . . . . . . . . . . . . . . . 216
Vsync Polarity Detection . . . . . . . . . . . . . . . . . . . . . . . . 216
Composite Sync Polarity Detection . . . . . . . . . . . . . . . . 216
Section 17. Input/Output (I/O) Ports
Table of Contents
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Technical Data
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