LFXP2-5E-5FTN256I Lattice, LFXP2-5E-5FTN256I Datasheet - Page 237

• Manufacturer Part Number: LFXP2-5E-5FTN256I
• Description: FPGA - Field Programmable Gate Array 5K LUTs 172 I/O Inst on DSP 1.2V -5 Spd
• Manufacturer: Lattice

Specifications of LFXP2-5E-5FTN256I

• Number Of Macrocells: 5000
• Number Of Programmable I/os: 172
• Data Ram Size: 169984
• Supply Voltage (max): 1.26 V
• Maximum Operating Temperature: + 100 C
• Minimum Operating Temperature: - 40 C
• Mounting Style: SMD/SMT
• Supply Voltage (min): 1.14 V
• Package / Case: FTBGA-256
• Number Of Logic Elements/cells: *
• Number Of Labs/clbs: *
• Total Ram Bits: 169984
• Number Of I /o: 172
• Number Of Gates: -
• Voltage - Supply: 1.14 V ~ 1.26 V
• Mounting Type: *
• Operating Temperature: -40°C ~ 100°C
• Lead Free Status / RoHS Status: Lead free / RoHS Compliant

Lattice Semiconductor
Figure 11-40. ODDRX2B Waveform
DELAYB
Data going to the DDR registers can be optionally delayed using the Delay block. The Delay block receives 4-bit
delay control. The 4-bit delay can be set using fixed multiplier values or it can be controlled by the user. The
DELAYB block is available for use with the input DDR registers.
The DELAYB block can be configured when generating the DDR input modules in the IPexpress tool of the soft-
ware. The delay can be adjusted in 35ps steps. Users can choose from three types of delay values:
A ( Mux0)
B ( Mux1)
Copy of A
Latch C0
Latch C1
Latch F0
( Mux0)
Reg D0
Reg A0
Reg B0
Reg A1
Reg B1
Reg E0
1. Dynamic – The delay value is controlled by the user logic using the DEL[3:0] input of the DELAYB block.
SCLK
SCLK
ECLK
DB0
DB1
DA0
DA1
Q
XX
XX
XX
XX
XX
XX
XX
XX
XX
XX
XX
XX
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XX
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11-33
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LatticeXP2 High-Speed I/O Interface
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