mt9072av2 Zarlink Semiconductor, mt9072av2 Datasheet - Page 18

• Manufacturer Part Number: mt9072av2
• Description: Octal T1/e1/j1 Framer
• Manufacturer: Zarlink Semiconductor

MT9072
Data Sheet
List of Tables
Table 49 - Alarms and Timers Status Registers (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95
Table 50 - Interrupt Vector and Interrupt Source Summary (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98
Table 51 - Interrupt Vector and Interrupt Source Summary (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 99
Table 52 - Interrupt Source & Status Register Summary (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101
Table 53 - JTAG Instruction Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
Table 54 - JTAG MT9072 Identification Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106
Table 55 - Framer Addressing (0XX - 9XX) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107
Table 56 - Register Group Address (Y00 - YFF) Summary (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
Table 57 - Global Control and Status (900 - 91F) Summary (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
Table 58 - Master Control Registers Address (Y00 to Y0F and YF0 to YFF) Summary (T1) . . . . . . . . . . . . . . . 110
Table 59 - Master Status Register(R) Address(Y1X) Summary (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
Table 60 - Latched Status Register (R) Address (Y2X) Summary (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 113
Table 61 - Interrupt Status Register (R) Address (Y3X) Summary (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 114
Table 62 - Interrupt Mask Register (R/W) Address (Y4X) Summary (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115
Table 63 - Framing Mode Select (R/W Address Y00) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116
Table 64 - Line Interface and Coding Word(Y01) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118
Table 65 - Transmit Alarm Control Word(Y02) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119
Table 66 - Transmit Error Control Word(Y03) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119
Table 67 - Signaling Control Word (Y04) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 120
Table 69 - HDLC & DataLink Control Word(Y06) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 122
Table 70 - Transmit Bit Oriented Message Register (Y07) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 122
Table 71 - Receive Bit Oriented Message Match Register(Y08) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123
Table 72 - Receive Idle Code Register(Y09) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123
Table 73 - Transmit Idle Code Register(Y0A) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123
Table 74 - Common Channel Signaling Map Register(Y0B) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123
Table 75 - Transmit Loop Activate Code Register(Y0D) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 124
Table 76 - Transmit Loop Deactivate Code Register(Y0E) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 124
Table 77 - Receive Loop Activate Code Match Register(Y0F) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 125
Table 78 - Receive Loop Deactivate code Match Register (R/W Address YF0) . . . . . . . . . . . . . . . . . . . . . . . . . 125
Table 79 - Synchronization and Alarm Status Word(Y10) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 126
Table 80 - Timer Status Word(Y11) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127
Table 81 - Receive Bit Oriented Message(Y12) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127
Table 82 - Receive Slip Buffer Status Word(Y13) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128
Table 83 - Transmit Slip Buffer Status Word(Y14) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129
Table 84 - PRBS Error Counter and CRC Multiframe Counter for PRBS(Y15) (T1) . . . . . . . . . . . . . . . . . . . . . . 129
Table 85 - Multiframe Out of Frame Counter(Y16) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129
Table 86 - Framing Bit Error Counter(Y17) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130
Table 87 - Bipolar Violation Counter(Y18) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130
Table 88 - CRC-6 Error Counter(Y19) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130
Table 89 - Out of Frame and Change of Frame Counters(Y1A) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130
Table 90 - Excessive Zero Counters(Y1B) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130
Table 91 - Transmit Byte Counter Position and HDLC Test Status(Y1C) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . 131
Table 92 - HDLC Status Word(Y1D) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131
Table 93 - HDLC Receive CRC(Y1E) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
Table 94 - Receive FIFO(Y1F) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
Table 95 - HDLC Status Latch(Y23) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 133
Table 96 - Receive Sync and Alarm Latch(Y24) (T1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134
Table 97 - Receive Line Status and Timer Latch(Y25) (T1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 135
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